Circuit Amplificateur LF398N DIP-8

Circuit Amplificateur LF398N DIP-8 , Circuit d’échantillonnage et de maintien LF398 .

UGS : DCD-01-T117

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Description

Circuit Amplificateur LF398N DIP-8 :

Le LF398 est un circuit échantillonneur-bloqueur monolithique qui utilise la technologie BI-FET pour obtenir une précision CC ultra-élevée avec une acquisition rapide du signal et un faible taux de statisme. Fonctionnant comme un suiveur de gain unitaire, la précision du gain en courant continu est de 0,002 % typique et le temps d’acquisition est aussi faible que 6 µs à 0,01 %. Un étage d’entrée bipolaire est utilisé pour obtenir une faible tension de décalage et une large bande passante. Le réglage du décalage d’entrée s’effectue avec une seule broche et ne dégrade pas la dérive du décalage d’entrée. La large bande passante permet au LF198 d’être inclus dans la boucle de rétroaction des amplis op 1 MHz sans avoir de problèmes de stabilité.

L’impédance d’entrée de 1010 Ω permet d’utiliser des impédances de source élevées sans dégrader la précision. Le FET à jonction canal P est combiné avec des dispositifs bipolaires dans l’amplificateur de sortie pour donner des taux de statisme aussi bas que 5 mV/min avec un condensateur de maintien de 1 µF. Les JFET ont un bruit beaucoup plus faible que les dispositifs MOS utilisés dans les conceptions précédentes et ne présentent pas d’instabilités à haute température. La conception globale garantit l’absence de traversée de l’entrée à la sortie en mode maintien, même pour des signaux d’entrée égaux aux tensions d’alimentation.

Brochage LF398

Configuration des broches LF398

N° broche Nom de la broche La description
1 V+ Tension d’alimentation positive
2 RÉGLAGE DU DÉCALAGE Broche de réglage du décalage
3 DANS Broche d’entrée
4 V- Tension d’alimentation négative
5 EN DEHORS Broche de sortie
6 CH Broche de canal
sept REF logique : Broche de référence logique
8 LOGIQUE Broche logique

Caractéristiques du LF398

  • Fonctionne à partir de ± 5 V à ± 18 V
  • Temps d’acquisition inférieur à 10 µs
  • Entrée logique compatible TTL, PMOS, CMOS
  • Pas de maintien typique de 0,5 mV à Ch = 0,01 µF
  • Faible décalage d’entrée
  • Précision de gain de 0,002 %
  • Faible bruit de sortie en mode maintien
  • Les caractéristiques d’entrée ne changent pas pendant le mode de maintien
  • Taux de rejet d’alimentation élevé dans l’échantillon ou la cale
  • Large bande passante

Application

  • Générateur de rampe
  • Commutateurs analogiques
  • Générateur d’escalier
  • Circuits d’échantillonnage et de différence

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